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专利择要显示,本公开是关于一种移位寄存器电路、移位寄存器电路掌握方法及电子设备,涉及集成电路技能领域。该移位寄存器电路包括:m个级联的触发器,第2级至第m级的所述触发器中至少部分所述触发器的时钟输入端设置有时钟掌握电路,所述时钟掌握电路吸收所述初始时钟旗子暗记并耦接第n级所述触发器的数据输入端和第n+1级所述触发器的数据输出端,用于在第n级所述触发器的数据输入端吸收的所述指令旗子暗记为有效电平时,掌握第n+1级所述触发器进行数据采样;在所述指令旗子暗记的有效电平被第n+1级所述触发器输出后,掌握第n+1级所述触发器停滞数据采样。本公开供应一种可以降落功耗的移位寄存器电路。
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